人才招聘
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  • 數字驗證工程師
  • 工作地區:
  • 上海 嘉定區
  • 招聘人數:
  • 1
  • 發布時間:
  • 2016-08-05
  • 職位描述:
  • 1.本科學歷以上,3年以上的數字電路設計和驗證經驗。

    2.要求熟練掌握Verilog語言。

    3.熟悉數字設計EDA工具和ASIC/SOC設計FLOW

    4.具有數字信號處理相關設計經驗者優先。

    5.要求具備很強的學習能力和獨立工作能力。

    6.很好的團隊協作精神。

    7.熱情、積極、主動的工作態度。

  • 任職要求:
  • 1.根據功能/性能要求,設計芯片數字部分邏輯模塊的微結構,并進行具體的RTL設計。

    2.改寫RTL代碼以符合FPGA實現的要求。

    3.進行模塊級的綜合、形式驗證以及靜態時序分析,進行時序、面積和功耗優化。

    4.編寫仿真模型、用例以及驗證平臺,與驗證工程師協同完成驗證。

    5.FPGA工程師協同完成FPGA驗證。

    6.AE工程師協同完成芯片DESIGN IN



    投遞郵箱:hr@iotelligent. com

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